अलावा के साथ 7-खंड के नेतृत्व में प्रदर्शन

0

सवाल

मैं कोशिश कर रहा हूँ करने के लिए जोड़ें 2 outputs, और उनके परिणाम में एक तीसरे/चौथे पर प्रदर्शित 7 खंड प्रदर्शन. प्रत्येक उत्पादन में दिखाया गया है अपने स्वयं के खंड क्रमशः. चौथी प्रदर्शन किया जा रहा है एक दो अंकों की संख्या (अधिकतम किया जा रहा है 14, Min किया जा रहा 0). मैं एक त्रुटि हो रही है यह बताते हुए कि मैं लिखने के लिए की जरूरत के सभी उदाहरणों के मामले में "जोड़ें". नहीं यकीन है कि जहां यहाँ से जाने के लिए. किसी भी मदद की सराहना की है ।

LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
ENTITY  Midterm2_Q2_4369 IS
PORT (

SW: IN STD_LOGIC_VECTOR(2 DOWNTO 0);
SW0: IN STD_LOGIC_VECTOR(2 DOWNTO 0);

ADD: IN STD_LOGIC_VECTOR(6 DOWNTO 0);
Y: OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
Y0: OUT STD_LOGIC_VECTOR(6 DOWNTO 0);
Y1: OUT STD_LOGIC_VECTOR(6 DOWNTO 0);

Y2: OUT STD_LOGIC_VECTOR(6 DOWNTO 0));
END Midterm2_Q2_4369;
ARCHITECTURE MUX8 OF Midterm2_Q2_4369 IS 
BEGIN
PROCESS (SW,SW0,ADD)
BEGIN
CASE SW IS
WHEN "000" => Y <= "0000001";

WHEN "001" => Y <= "1001111";

WHEN "010" => Y <= "0010010";

WHEN "011" => Y <= "0000110";

WHEN "100" => Y <= "1001100";

WHEN "101" => Y <= "0100100";

WHEN "110" => Y <= "0100000";

WHEN "111" => Y <= "0001111";
END CASE;

CASE SW0 IS
WHEN "000" => Y0 <= "0000001";

WHEN "001" => Y0 <= "1001111";

WHEN "010" => Y0 <= "0010010";

WHEN "011" => Y0 <= "0000110";

WHEN "100" => Y0 <= "1001100";

WHEN "101" => Y0 <= "0100100";

WHEN "110" => Y0 <= "0100000";

WHEN "111" => Y0 <= "0001111";
END CASE;

CASE ADD IS
WHEN "0000000" => Y1 <= "0000001"; --0

WHEN "0000001" => Y1 <= "1001111"; --1

WHEN "0000010" => Y1 <= "0010010"; --2

WHEN "0000011" => Y1 <= "0000110"; --3

WHEN "0000100" => Y1 <= "1001100"; --4

WHEN "0000101" => Y1 <= "0100100"; --5

WHEN "0000110" => Y1 <= "0100000"; --6

WHEN "0000111" => Y1 <= "0001111"; --7

WHEN "0001111" => Y1 <= "0000000"; --8

WHEN "0010111" => Y1 <= "0000100"; --9
     --8421421
WHEN "0011111" => Y2 <= "1001111"; --(1)0

WHEN "0100111" => Y2 <= "1001111"; --(1)1

WHEN "0101111" => Y2 <= "1001111"; --(1)2

WHEN "0110111" => Y2 <= "1001111"; --(1)3

WHEN "0111111" => Y2 <= "1001111"; --(1)4--

WHEN "1000111" => Y2 <= "1001111"; --(1)5

WHEN "1001111" => Y2 <= "1001111"; --(1)6

WHEN "1010111" => Y2 <= "1001111"; --(1)7--

WHEN "1011111" => Y2 <= "1001111"; --(1)8

WHEN "1100111" => Y2 <= "1001111"; --(1)9
END CASE;

END PROCESS;
END MUX8;
case seven-segment-display vhdl
2021-11-18 17:19:32
1

सबसे अच्छा जवाब

2

जब का उपयोग कर एक case में VHDL, सभी मामलों में शामिल किया जाना चाहिए. क्योंकि SW, SW0 और ADD सभी कर रहे हैं std_logic_vector, आप भी कवर के सभी मेटा तरह के मामलों "UUUUUUUU", आदि. सबसे आसान तरीका है यह करने के लिए के साथ others.

के लिए उदाहरण है । SW0 गया है सभी "असली" मामलों में शामिल है, लेकिन आप चाहिए भी कवर मूल्यों है कि कर सकते हैं केवल में होते हैं, सिमुलेशन, तो प्रदान एक आसान संदेश:

CASE SW0 IS
  WHEN "000" => Y0 <= "0000001";
  WHEN "001" => Y0 <= "1001111";
  WHEN "010" => Y0 <= "0010010";
  WHEN "011" => Y0 <= "0000110";
  WHEN "100" => Y0 <= "1001100";
  WHEN "101" => Y0 <= "0100100";
  WHEN "110" => Y0 <= "0100000";
  WHEN "111" => Y0 <= "0001111";
  when others => report "Meta value detected" severity warning;-- simulation only case
END CASE;

तुम भी सुनिश्चित करना चाहिए सभी मामलों को कवर कर रहे हैं के लिए SW और ADD भी

2021-11-19 17:19:30

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